fpga时序通过但程序出问题

程序设计问题。

FPGA时序通过后，需要编写程序来控制FPGA的输入输出。程序设计可能存在问题，如逻辑错误、数据类型不匹配等，导致程序运行错误。

FPGA时序是指在FPGA芯片内部以及与外部器件之间，各种数据信号和时钟信号的传输时间和延迟时间等参数的规定和限制。

1、，将fpqa烧录文件相关路径内的文件全部删除，确保生成的所有文件都是最新的。

2、，再次编译时会提示错误，因为删除了太多文件导致的。

3、，针对第二步的问题，在compile工具上右键，出现下图提示：还是第二步的问题，点击确定即可。

4、，点击确定后，会提示重新保存个adb文件，直接点击保存即可。

下载后，FPGA就跟一颗ASIC一样了，你只能做板级调试。任何FPGA内部的改动都需要重新编译再下载进去。当然，你可以把内部逻辑通过不用的IO引出来接逻辑分析仪，这是FPGA方便的地方。

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