在运行nios ii时出现downloading Elf process failed，该怎么解决

1、nios2

cpu

datamaster

没有和on

chinp

ram

连接，导致程序在系统ram上无法下载。

2、在加载SDRAM模块时应注意其参数的准确性，否则同样影响data总线数据传输导致该问题。

3、还有，在建立工程选择软核sopcinfo文件时要注意路径，一般nios

ii

新建工程时默认上一次工程的sopcinfo文件，很容易就选择了该文件，导致运行失败。。

解决方法：

关掉Nios

II

IDE重新编译。

你好。

1 Quartus是Altera 公司的FPGA开发软件，你用它来写硬件描述语言的程序然后生成电路模块，或者画电路原理图，完成理论上的设计。

2 在Quartus中，所有器件都是用模块表示的，小到一个非门，大到一个CPU，都是用框图加输入输出引脚描述的。其中，使用Altera技术在FPGA上生成的CPU叫做Nios，目前主流版本是Nios 2。以Nios 2为核心的设计需要用另一个软件，Nios Integrated Design Environment (IDE)，与Quartus联用，在这个软件中你可以写C/C++程序在Nios 2上运行。这是Nios 2相当于一个单片机。

3 DSP Builder是Matlab中的插件，通过Simulink搭建系统框图，用该插件可直接生成在Quartus中可以引用的模块。

4 你当然可以复制个代码改改……秒表实际上用不着Nios 2就可以完成……很多地方都可以下载到……其实真正的工作量不在编写代码上，而在于对这一系列软件的学习过程上。有很多诡异的错误要调试。

同一个项目可以用NIOS2也可以不用就可以完成，这句话说对也可以说不对，这要看是一个什么样的项目，你那样问的话可就说明有CPU和没CPU下的使用情况你还没有搞清楚，这两者并没有完全分开，简单的说就是有交集的地方，FPGA在使用VERILOG情况下，他只是一种硬件怎么说呢，举个不恰当的比喻：就像是人没有大脑一样，没有大脑的情况下人体有的部分受刺激还是可以起反应的，再者在VERILOG的情况下程序运行是并行的，这与在NIOS2的情况下完全不同的，你可以去看在CPU加上系统后对于程序怎么运行的一般用词都是并发而非并行，这是有很大区别的。有NIOS2的情况下那就不同了，可以说不是在没有NIOS2的情况下可以比的，就是人没大脑和有大脑一样，说到底在VERILOG情况下就是一些与非门，而在NIOS2是有一块CPU的。对你最后问的，就像只要点一个灯两者都可以，但是你如果驱动USB，两者都可以，但是NIOS2下驱动要快很多，再者你如果开发一个比较大的产品比喻变频器控制部分那么VERILOG有无能为力了。但如果只作数据传输或是流水线如果用NIOS2那么就显得有点那个什么的了。

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