怎样学习FPGA 学习使用VERILOG 编程，实现简答的VGA游戏，如打砖块

首先学习最简单的，基础学习，然后去看一下VGA控制时序，然后去实现就可以了，打砖块游戏就是控制显示的问题，需要做一图形，然后存储，根据当前的XY坐标来判断是不是显示，这样子就可以了。

FPGA 的独特优势在于其灵活性，即随时可以改变芯片功能，在技术还未成熟的阶段，这种特性能够降低产品的成本与风险，在 5G 初期这种特性尤为重要。

优势一：

更大的并行度。这个主要是通过并发和流水两种技术实现。

A：并发是指重复分配计算资源，使得多个模块之间可以同时独立进行计算。这一点与现在的多核和SIMD技术相似。但相对与SIMD技术，FPGA的并发可以在不同逻辑功能之间进行，而不局限于同时执行相同的功能。举个简单例子说就是使用SIMD 可以同时执行多个加法，而FPGA可以同时执行多个加法和乘法和任何你能设计出来的逻辑。

B：流水是通过将任务分段，段与段之间同时执行。其实这一点和CPU相似，只是CPU是指令间的流水而FPGA是任务间流水或者可以说是线程间流水。

优势二：

可定制。FPGA 内部通过Lookup Table实现逻辑，可以简单理解为是硬件电路。可定制指的是在资源允许范围内，用户可实现自己的逻辑电路。通常情况下任务在硬件电路上跑是比在软件上快的，比如要比较一个64位数高32位和低32位的大小，在CPU下需要2条区数指令，两条位与指令，一条移位指令一条比较指令和一条写回指令，而在FPGA下只要一个比较器就行了。

优势三：

可重构。可重构指的是FPGA内部的逻辑可根据需求改变，减少开发成本。同时，使用FPGA复用资源比使用多个固定的ASIC模块为服务器省下更多的空间。

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这是一个 RAM的程序。

这里面用到了类似 数组 的概念。

reg[7:0] Memory [63:0]; 这个定义表示 64 个 8bits 数。

always @(posedge dataInterrupt)

begin

if(dataIn ==8'h30)

begin // 这个if 表示 输入数据为 8'h30 的时候，

memIndex<=0; // 地址为 0

Memory[0]<=8'hff; // 0地址存储的数据为 8'hff

end

else

begin

Memory[memIndex]<=dataIn; // 将输入数据写入对应的地址中

memIndex<=memIndex+1'b1; // 地址自增 1

if (memIndex == 63)

begin

memIndex<=63; // 写满了64个数据，就不动了，除非输入数据为 8'h30

end

end

end

assign dataOut = Memory[Address]; //这是读数据，将 address 地址对应的数据读出来。

你的时序有问题。而且驱动AD的信号速度要符合AD芯片的标准。FPGA的工作速度可以远远高于AD采样芯片的工作速度，如果不同步，就会造成FPGA逻辑模块出现异常的情况而无法执行，也就是说状态机运行到了无法继续转移状态的类似于死机的状态。

因为，只要复位就可以正常采样几次，多半都是这类问题。再好好查查吧。应该没什么大问题

正确是4‘b0 因为不存在led7:4，但是一般编辑器规则会自动将低四位赋值，而不会报错（可能部分编译器会有warming信息，你仔细看看）。能正常使用。

如果写了 IF(LED=8'B11111111)，编译器可能会将这个IF优化掉，IF内的语句永远执行。因为LED只有4位，永远不会满足IF条件。

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